fpga小白学习之路erro:buffersofthesamedirectioncannotbeplacedinseries

关键词：

 1 // demo1 two bufg connect
 2 
 3 module iobuf(
 4 
 5  　　input 　　clk,
 6 
 7 　　 input 　　rst,
 8 
 9  　　output　　led
10 
11  　　);
12 
13  wire clkin_w;
14 
15  BUFG BUFG_inst(
16 
17       .O(clkin_w),           // Clock buffer output
18 
19       .I(clk)                   // Clock buffer input
20 
21    　　);
22 
23  pll0 u_pll0(
24 
25     　　.CLK_IN1(clkin_w),      // IN
26 
27     　　.CLK_OUT1(clkout),  // OUT
28 
29     　　.RESET(rst));       // IN
30 
31 assign led = clkout;
32 
33 endmodule

1 NET clk          CLOCK_DEDICATED_ROUTE = FALSE;

 1 // demo2 regular io directly connect to PLL
 2 
 3 module iobuf(
 4 
 5     input clk,
 6 
 7  　　input     rst,
 8 
 9  　　output   led
10 
11  );
12   
13 
14 
15  pll0 u_pll0(
16 
17     .CLK_IN1(clk),      // IN
18 
19     .CLK_OUT1(clkout),  // OUT
20 
21     .RESET(rst));       // IN
22 
23 assign led = clkout;
24 
25 endmodule

 1 // dem3 regular io with BUFG then connect to PLL which with"No Buffer" setting
 2 
 3  module iobuf(
 4 
 5  　　input　　clk,
 6 
 7  　　input　　rst,
 8 
 9  　　output　　led
10 
11  　　);
12 
13  wire clkin_w;
14 
15  BUFG BUFG_inst (
16 
17       .O(clkin_w),           // Clock buffer output
18 
19       .I(clk)                   // Clock buffer input
20 
21    );
22 
23  pll0 u_pll0(
24 
25     .CLK_IN1(clkin_w),      // IN
26 
27     .CLK_OUT1(clkout),  // OUT
28 
29     .RESET(rst));       // IN
30 
31 assign led = clkout;
32 
33 endmodule

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